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    protel pcb制图课程设计模板Word格式文档下载.docx

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    protel pcb制图课程设计模板Word格式文档下载.docx

    1、2.3.1在添加元件的时候发现要手动的寻找一个元件比较困难,于是我就用了左边一个find功能,设置好路径后就可以在整个库里寻找找到后按plce按钮就可以放在原理图中。2.3.2在电气规则检查中我的错误最开始的有12个,我先检查了一遍电路图,我发现有一小段线没有连接上去,我接上去以后,错误减少到了0个。我检查了每个管脚都连上了线,后来我看了好久,终于发现我的有几个网络标号的字母写错了,在我改正以后我把错误减少到了4个。.3.3在确定连线绝对没有连错的时候,我把文件复制到了别人的电脑里,发现错误没有了。在小组的努力下,我们在网上搜索了一下解决的方案,发现要通过更改元件管脚的属性才可以。就是把管脚的

    2、inu类型改成assive。2.小结 在画电路原理图的过程中,要注意各个元器件之间的摆放,还要注意连线,还要注意管脚与管脚的连接关系。在检查错误的时候,如果是warnn则可以忽略,不过也要认真检查。原理图一定要好好检查,这是第一步,也是最重要的一步。.1pcb版的制作过程.1生成元件清单,用edit菜单下的eot tprad功能就可以输出元件的清单。在第一个选项中选择at,第二个选项菜单中选中ootpri和partTpe还有esignat便可以导出元件的数目,名称还有在pcb元件封装库中管脚的名称。.12 在确定好所有的元件都已经正确而且在库中有元件时,便可以用deign里的creae nes

    3、lst按钮,便可以生成网络表,可以看出来那些东西是连线在一起的。3.1.3 然后在文件夹中新建一个pb文件,设置好布线的参数(在dig里的uls设置好参数)然后在desin里面有个loa ne,按钮就可以帮刚刚生成的网络表导出在pb板中。在vie中的fiboar就可以看到生成的结果。(在此之前要在p中添加好库文件,不然不能生成相应的元件。)3.4 蓝色的线就是表示要连接的地方,这时我们可以在eeotlaer那里画一个边框,然后把元件往里面拖,合理的布局好,尽量设计得小一点、紧密点。3.5接着就可以布线了,此时可以选择自动布线在autorout里的route all便可以布线成功了,当然可以选择

    4、手动布线,在蓝色线相连的地方都布上线。.1.6然后用tol里的esgn rule ceck检测看一下有没有错误,如果没有错误就可以了。3.2 期间遇到的问题321在生成元件清单的时候,发现有很多管脚没有封装,我在网上查阅了相关资料之后,设置好了管脚和。成功生成了元件清单和网络表。3.2在布局的时候,如果有元件重叠就会变成绿色也就是有错误,此时只要分开就可以了。3.2.3在布线的时候要注意管脚和线的距离,还有穿孔的大小。2.自动布局和自动布线给我们提供了很大的方便。3.2.在检测错误的时候,要根据要求设置好有关的参数,测出错误以后再改正。33小结 在这部分过程中,最重要的是每个元件都要在p元件库

    5、中有封装。保证能在pc板中能生成元件。在布局的时候还要合理,穿孔的大小要合适。关于元件库的问题就是一定要用C库里面有的元件才可以画出PB板。3.4元件清单OjeKindPathDsgatorFoorinPartTypePatheet1.ScX1XTAL1.432Mharthet1.ShR2AIAL0.41K5arSheet1.cRES1AXIL0.4MPrtSheet.Sh2DP14488PartShet1.ScUP14148ParU4D4485IP1148PrShe1ScU6DIP118Shet1.SchU7DIP1449Sh1.cU8149SeSU9D149SeetSnDB37AFDB7e

    6、t1chU1GA68X1KTL1654Sheet1.chC4RA0uFPSheet1.ScCRAD0.20.FSheet1.SC201uFSet1.SchC1RD0.Shet1Sch13RA.20pFhet1.ScC1450rtSh1.ch100.uFCD0.1uhet.hC9D0.20.1ee1SchC8RAD20.uill oMatial forhee1.BomUsed ParTye Dsinatr Fotrint Descriptin= = = 0.1uF C1C2 C3 RAD0.2 Capco 0 pith C5 8 C9C101 1.8432Mhz X1 XTAL11 1K5 R2

    7、 AXIAL.41 M RE1 AXIAL 20p C13 RD0. Cpaitor 0.2pitch1 5F C14 RD0.2 apacto.pich3 1488 U 3 U DIP14 T-R232 VE5 489 U5 U U7 IP14 489S23T CNVRTO 8 U91 D7 n DB37RAF 1554 U G61_KT3.5网络表*PA811_SKTTL16C5542RAD02.1uFC30.1FRAD0.AD0.2CA.29.uC13AD022pF1450pFAXIAL0.41KREU21488U3DP4DIP4U548914DP1DI11489DI1418432RA/

    8、FDB37(+1VC5-C1-1U2-1-14-12V8-1C9-1U2131-1A0*-34A*-32CTSA-115-1CTSB*-257-3TC*-45U8-6CSD*-59U98D*-66D1*-67D2*-68D3*-1D*-2D5-36*-4D-5DA*-9U3DCDB*-27U66DCDC*43U8DCDD-61U11R*-10U5-8DSB*26U6-11DRC44U-3DSD*-69-6DTA*-12U-42-5DTRB*2432DR*3-12U-13TR*-8U4410N*-6*-23*-40*57C1-22-2C324-2C5-2C82C9-10-2C1-2C14-2U3

    9、-74-7U-7U67-7U-7U9-n-17n-8n-1936n371U-1n-12-10n-J3U-4n-2JU8n-21J5U2-3n36-13n2J7U26n4JU61n-3J11U-n-5J126134J13U6-0-6J1U3-6n-25J1U2-1n-171n2617U3-3n-88U-n2J21U7-10n-9281n28J2U7-13n-1J2U4-n-2J53-8-1J2684nJ27U31-12J28U8-0n-J31U8-13n-13J329-4n-32J33U9-114J3U-11-3334-6n-1J36U9-10-34J7U4-8n-16J38U9-13n35et

    10、*_5*-15et*_16*-16t*_8*1Ne*_0-20Nt*_1*1et*_7-7Net*_9-49Net50*-0Net*_52*-2et*_54*-4Net*_55NeC13*35C3-1ES-2X1-tC_114-1R2-1RES111-1et2_2*-36R2-IA-8U6B*-2U7-6IC-2U8ID*-62U9-11TA-12-9U2-0RTSB*-22U-4U3TSC*-8U4-2TS-56U41U4-1RXA-U5-6B-6XC*-41-1RXD-63-3T*17U-X*9U-12U-3TXC*-513-9U31TXD*U-4U4-5VCC-1*-0*-764C112

    11、-C31C4-1UU6-14U7-1U-14U9-44总结Proel99se被现代电子设计者们广泛的使用,我们作为电子信息工程专业的学生,理应熟练掌握这种实用性好、专业性强的软件,为此老师组织我们进行了rol9e的学习。经过对oel99s一周的学习和应用,开始的无法上手,现在已经对其性能应用有初步了解,虽然期间遇到了很多问题,但是通过同学之间的讨论都解决了,所以觉得受益匪浅。在老师指导软件的初步操作技能之后,我们开始设计了。开始是按设计图布线,第一次做用的汉化版,所以熟悉的也要快点,在设计的时候就出现了问题,最后才发现是连接导线到总线的时候没有用上总线接入线,后来从头改过之后终于完成。开始也不

    12、知道要封装,所以第一次没有封装,然后进行ER电气检查,有很多错误,然后返回SCH制作页面,发现是有2个网络标号标记错误和一条总线断掉,修改错误后再检查就没问题了。紧接着是制作网络表,这时我是靠观看视频来学习的,再是创建P电路板,这时就发现有很多错误,这时我才知道元件需要仔细设置管脚(Fooprnt),即元件的封装,我上网搜了一个封装表,里面有很多封装形式,电阻电容都有它各自的封装形式,于是我对它们进行封装,再制作网络表导入PCB,发现还是有问题,后来才发现,我们Prtel99se软件本身就有一个P封装库,一些常用元件就有它自己的封装,如果没有封装形式,就需要按照元件实际大小进行封装设计,比如L

    13、1C5在封装库就有它自己的封装形式,它的封装形式就是PGA681_T,这在封装库中libra是可以找到的,这时再对CH文件中进行封装,制作网络表,从60个错误剩下了只有个错误了,这个错误都和电阻R1有关,经过分析,最后发现是最开始做SCH文件时,自己编辑电阻管脚长度忘记管脚OD的标记,这样再对它进行修改后,网络表中就没有错误了。导入PC的制作,PCB的制作有很多规则,首先要满足可行性,再是要节省,画出板的大小后,就可以将元件添加进去了,第一次手动布线,花了很长时间还是做不好,最后采用了自动布线,我想,一块好的PCB需要人的手动布线,好的手动布线需要人长时间的训练磨出来的,制作好PC后是铺地,最后制作的PCB板完整完成了。附 录5.1全图 5.丝印层(topovrlayer)5顶层(opLy)5.底层(BottmLer).5铺地图:5.6未铺地图:参考文献.王彦平:Pote9电路设计指南 清华大学出版社2000版;2 朱定华:Prote 9 SE原理图和印制板设计清华大学出版社2007版;3. 万华清:Prtel 9 SE电路设计人民邮电出版社2007版


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