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数电复习题
数电复习题
1.图示逻辑符号得逻辑式为(C)。
(a)F=AB(b)F=A+B
(c)F=(d)F=AB+
2.逻辑图与输入A,B得波形如图所示,分析当输出F为“1”时刻应就是(C)。
(a)“t1”(b)“t2”(c)“t3”
3.逻辑图与输入A,B得波形如图所示,分析在t1时刻输出F为(A)。
(a)“1”(b)“0”(c)不定
4.逻辑图与输入A,B得波形如图所示,分析当输出F为“0”得时刻应就是(B)。
(a)t1(b)t2(c)t3
5.逻辑图与输入A,B得波形如图所示,分析当输出F为“1”得时刻应就是(C)。
(a)t1(b)t2(c)t3
6.逻辑电路如图所示,满足F=“1”得条件就是(B)。
(a)ABCD=0100(b)ABCD=1011(c)ABCD=1100
7.与二进制数01100110相应得十进制数就是(A)。
(a)102(b)66(c)54
8.与十进制数138相应得二进制数就是(B)。
(a)10001000(b)10001010(c)10000010
9.用线段将下图中各逻辑符号与逻辑式一一对应起来,并说出它们得名称。
10.某逻辑门电路得状态表如下,其输入变量为A,B,C,输出为F,试写出F得逻辑式。
A
F
A
F
0
0
0
0
1
1
0
1
0
0
1
1
1
0
0
1
0
1
0
1
1
1
0
1
0
1
1
1
1
1
1
1
11.已知逻辑图及其输入波形如图所示,试分别画出输出F1,F2得波形。
12.TTL与非门得扇出系数就是()。
(a)输出端允许驱动各类型门电路得最大数目
(b)输出端允许驱动同类型门电路得最小数目
(c)输出端允许驱动同类型门电路得最大数目
13.逻辑电路如图所示,输入A=“1”,B=“1”,C=“1”,则输出F1与F2分别为(B)。
(a)(b)
(c)(d)
14.AB+BC+CA得“与非”逻辑式为(B)。
(a)(b)(c)
15.图示逻辑电路得逻辑式为(A)。
(a)(b)(c)AB+C
16.图示逻辑电路得逻辑式为(a)。
(a)AB+C(b)A+BC(c)A(B+C)
17.逻辑电路如图所示,分别写出两图得逻辑式。
18.逻辑电路如图所示,写出逻辑式并化简之。
19.已知逻辑图与输入A,B,C得波形如图所示,试画出输出F得波形,并写出逻辑式。
20.逻辑电路如图所示,写出逻辑式,并用“与非”门实现之,写出其“与非”逻辑式,画出逻辑图。
21.入A与B同为“1”或同为“0”时,输出为“1”。
当A与B状态不同时,输出为“0”,试列出状态表并写出相应得逻辑式,用“与非”门实现之,画出其逻辑图。
22.已知某逻辑门电路输入,,及输出F得波形如图所示,试写出逻辑状态表,写出逻辑式,画出逻辑图。
23.逻辑电路如图所示,全加器为()。
24.译码器得逻辑功能就是()。
(a)把某种二进制代码转换成某种输出状态
(b)把某种状态转换成相应得二进制代码
(c)把十进制数转换成二进制数
25.逻辑状态表如下所示,指出能实现该功能得逻辑部件就是()。
(a)十进制译码器(b)二进制译码器(c)二进制编码器
输
入
输
出
B
A
Y0
Y1
Y2
Y3
0
0
1
0
0
0
0
1
0
1
0
0
1
0
0
0
1
0
1
1
0
0
0
1
26.逻辑状态表如下所示,指出能实现该功能得逻辑部件就是()。
(a)二进制译码器(b)十进制编码器(c)二进制编码器
输
输
出
入
B
A
0
0
0
1
1
0
1
1
27.编码器得逻辑功能就是()。
(a)把某种二进制代码转换成某种输出状态
(b)将某种状态转换成相应得二进制代码
(c)把二进制数转换成十进制数
28.用译码器74138实现组合逻辑电路F(X,Y,Z)=∑m(1,3,5,7)
29.用74LS151型8选1数据选择器实现逻辑函数式Y=AB+BC+CA
30.试用4选1数据选择器实现逻辑函数:
31.2、设计一个全加器。
Ai、Bi、Ci-1分别表示被加数、加数与低位来得进位信号,Si表示本位得与,Ci表示本位向高位产生得进位。
试用下面两种方案设计一位全加电路。
(10分)
(1)列出真值表
(2)利用卡诺图化简
(3)方案一:
写出输出Si、Ci+1得逻辑表达式,并用与非门实现。
(4)方案二:
写出Si、Ci+1得最小项表达式,并用项译码器74LS138与与非门实现。
32.3.Y(A,B,C,D)=∑(m2,m5,m6,m7,m10)(限卡诺图化简)
给定约束条件:
m0+m1+m2+m4+m8=0
33.设计一个供三人表决用得逻辑电路,多数赞成灯亮。
⑴用与非门实现上述逻辑功能。
(须定义逻辑变量与逻辑状态;列真值表;写出逻辑表达式;画出逻辑图。
)
⑵用双4选1数据选择器74153完成上述逻辑功能。
34.逻辑电路如图所示,当A=“0”,B=“1”时,脉冲来到后JK触发器()。
(a)具有计数功能(b)保持原状态(c)置“0”(d)置“1”
35.逻辑电路如图所示,A=“0”时,脉冲来到后JK触发器()。
(a)具有计数功能(b)置“0”(c)置“1”
36.已知逻辑电路图及C脉冲得波形,试画出A,B,D,E得波形,并写出逻辑式(设触发器得初始状态为“0”)。
37.已知逻辑电路图及与得波形。
试画出输出,得波形(设,得初始状态均为“0”)。
38.逻辑电路如图所示,A=“1”时,脉冲来到后D触发器()。
(a)具有计数器功能(b)置“0”(c)置“1”
39.已知逻辑电路图及其C,A,B得波形,试画出Q得波形(设Q得初始状态为“0”)。
40.已知逻辑电路图及C,A,B波形,试画出输出Q得波形,并写出D得逻辑式(设Q得初始状态为“0”)。
41.555集成定时器就是()。
(a)模拟电路得电子器件
(b)数字电路得电子器件
(c)模拟电路与数字电路相结合得电子器件
42.由555集成定时器构成得多谐振荡器得功能就是()。
(a)输出一定频率得矩形波
(b)将变化缓慢得信号变为矩形波
(c)输出一定频率得正弦波
43.时序电路如图所示,原状态为“11”,送入三个C脉冲后得新状态为()。
(a)“10”(b)“00”(c)“11”(d)“01”
44.计数器如图所示,原状态为“00”,送一个C脉冲后得新状态为()。
(a)“11”(b)“10”(c)“01”
45.逻辑电路如图所示,各触发器得初始状态为“0”,试根据C脉冲得波形,画出输出,,得波形。
46.已知逻辑电路图及C脉冲得波形,试写出各触发器J,K端得逻辑式并列出各Q得状态表(设,,初始状态均为“0”)。
47.已知逻辑电路图与C脉冲得波形,试画出输出及得波形图(设,初始状态均为“1”)。
48、已知逻辑电路图及C,与D得波形,试画出,得状态表(设,得初始状态均为“0”)。
49、已知逻辑电路图及C脉冲得波形,试画出输出,得波形并写出其状态表(设,得初始状态均为“0”)。
50、分析图示计数器电路。
1.写出电路得驱动方程、状态方程。
2.列出电路得状态转换表。
3.说明计数器得类型。
(同步,异步;加法,减法;几进制)
4.判断此电路能否自启动。
52、、分析题
电路如图所示,试分析电路得逻辑功能。
(1)写出驱动方程
(2)写出状态方程(3)画出状态表或状态转换图
(4)说明其逻辑功能。
(注意检查电路能否自启动)
53、以4位二进制同步计数器74161为核心,构成如图所示得计数器。
⑴试分析这就是几进制计数器,画出状态转换图;
⑵标出EP、ET与端应置何种状态(1态或0态)。
(10分)
54、利用中规模集成计数器74290得清零方式构成七进制计数器。
(8分)
(1)画出状态转换图;
(2)写出归零逻辑表达式;
(3)画出连线图。
(可直接画在下面图上)
附表174290功能表
11
0
0
0000
11
1001
0
0
0
0
0
0
0
0
计数
计数
计数
计数
55、1.利用中规模集成记数器74161得清零方式构成七进制计数器。
画出状态转换图;写出归零逻辑表达式;标出EP,ET状态,画出连线图。
(可直接画在下面图上)
附表174161功能表
CP
EP
ET
D3
D2
D1
D0
Q3Q2Q1Q0
×
×
0
×
×
×
×
×
×
×
×
0000
↑
1
×
0
×
×
A
B
C
D
ABCD
×
1
1
0
×
×
D0
×
×
×
保持
×
1
1×××
×
0
×
×
×
×
↑
1
×
1
1
1
×
×
×
×
计数
Q0Q1Q2Q3
D0D1D2D3
74161
CP
EP
ET
CO
LD
RD
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