福师《数字逻辑》在线作业二000677BB03AAWord格式文档下载.docx
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ROFF<RI<RON
>ROFF
C
TTL电路中,高电平VH的标称值是()
0.3V
2.4V
3.6V
5V
一个8选一数据选择器的数据输入端有()个
1
2
3
8
D
一个T触发器,在T=1时,来一个时钟脉冲后,则触发器()。
保持原态
置0
置1
翻转
欲设计0,1,2,3,4,5,6,7这几个数的计数器,如果设计合理,采用同步二进制计数器,最少应使用()级触发器
4
B
组合逻辑电路中的险象是由于()引起的
电路未达到最简
电路有多个输出
电路中的时延
逻辑门类型不同
是8421BCD码的是()
1010
0101
1100
1111
逻辑表达式Y=AB可以用()实现
正或门
正非门
正与门
或非门
在下列逻辑电路中,不是组合逻辑电路的有()
译码器
编码器
全加器
寄存器
把一个五进制计数器与一个四进制计数器串联可得到()进制计数器
5
9
20
在一个8位的存储单元中,能够存储的最大无符号整数是().
(256)10
(127)10
(FE)16
(255)10
555的余3码为()
101101101
:
010*********
100010001000
和二进制数(1100110111.001)等值的十六进制数学是()。
337.2
637.2
1467.1
c37.4
和二进制码1100对应的格雷码是()
0011
主从触发器的触发方式是()
CP=1
CP上升沿
CP下降沿
分两次处理
设计一个8421码加1计数器,至少需要()触发器
6
10
在何种输入情况下,“或非”运算的结果是逻辑1().
全部输入是0
全部输入是1
任一输入为0,其他输入为1
任一输入为1
以下代码中为恒权码的为().
循环码
5421BCD码
余三码
格雷码
下列逻辑门中,()不属于通用逻辑门
与非门
或门
与或非门
优先编码器的编码信号是相互排斥的,不允许多个编码信号同时有效。
()
错误
正确
计算器的模是指构成计数器的触发器的个数
TTLOC门(集电极开路门)的输出端可以直接相连,实现线与。
一般TTL门电路的输出端可以直接相连,实现线与。
数字系统中,寄存器间只有信息传送微操作。
实际逻辑电路中,信号经过同一电路中的不同路径所产生的时延一般来说是相同的
三态门的三种状态分别为:
高电平、低电平、不高不低的电压。
在卡诺图中,每一个方格表示逻辑函数的一个最小项
基本的RS触发器具有空翻现象
OC门,即集电极开路门,是一种能够实现线逻辑的电路。
奇偶校验码能发现两位(或偶数位)出错
方波的占空比为0.5。
一个触发器能够记忆“0”和“1”两种状态
若两个函数具有不同的逻辑函数式,则两个逻辑函数必然不相等。
因为逻辑表达式A+B+AB=A+B成立,所以AB=0成立。
编码与译码是互逆的过程。
利用反馈归零法获得N进制计数器时,若为异步置零方式,则状态SN只是短暂的过渡状态,不能稳定而是立刻变为0状态。
0FEH是我们数制中的十六进制。
实际上,信号经过任何逻辑门和导线都回产生时间延迟。
数的真值形式是一种原始形式,不能直接用于计算机中
利用卡诺图合并最小项时,所有为1的方格必须要圈。
已经X+Y=X+Z,则Y=Z
十进制数(9)10比十六进制数(9)16小。
逻辑代数只有与运算、或运算、非运算。
5个触发器最多可以构成16进制计数器
下列触发器中,没法约束条件的是()
时钟R--S触发器
基本R--S触发器
主从J--K触发器
边沿D触发器
C,D
以下电路中可以实现“线与”功能的有哪些().
三态输出门
集电极开路门
漏极开路门
数字逻辑电路一般分为()。
组合逻辑电路
时序逻辑电路
同步逻辑电路
异步逻辑电路
A,B
逻辑代数包括的三种基本运算是
(
)
。
与
或
异或
非
A,B,D
TTL电路在正逻辑系统中,以下各种输入中()相当于输入逻辑“1”。
悬空
通过电阻2.7kΩ接电源
通过电阻2.7kΩ接地
通过电阻510Ω接地
A,B,C
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