设计一个四位可逆二进制计数器的实验报告.docx
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设计一个四位可逆二进制计数器的实验报告
实验七设计一个四位可逆二进制计数器
一、实验目的
掌握中规模集成计数器的使用方法及功能测试方法。
二、实验内容及要求
用D触发器设计一个异步四位二进制可逆计数器。
三、设计过程
(1)根据题意列出加计数状态表和驱动表,如下表所示。
序号
现 态
次 态
驱 动 信 号
Qn3
Qn2
Qn1
Qn0
Qn+13
Qn+12
Qn+11
Qn+10
D3
CP3
D2
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(2)用卡诺图化简,如下图所示。
求得各位触器的驱动信号的表达式
Q1Q0
Q3Q2
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(2)用卡诺图化简,如下图所示。
求得各位触器的时钟方程的表达式
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(3)根据题意列出减计数状态表和驱动表,如下表所示。
序号
现 态
次 态
驱 动 信 号
Qn3
Qn2
Qn1
Qn0
Qn+13
Qn+12
Qn+11
Qn+10
D3
CP3
D2
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(2)用卡诺图化简,如下图所示。
求得各位触器的驱动信号的表达式
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(2)用卡诺图化简,如下图所示。
求得各位触器的时钟方程的表达式
Q1Q0
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×
由上分析可知:
加减计数只在于时钟CP的不同,若要使一个电路能够可逆计数,增设一控制开关,就可实现。
设K=1时为加计数,设K=0时为减计数,
加法:
CPn=
减法:
CPn=
则有:
CPn=
(或如K=0时为加法:
CPn=
K=1时为减法:
CPn=
=
则有:
CPn=
)
四、可逆计数器逻辑图如下:
四、实验用仪器、仪表
数字电路实验箱、万用表、74LS74、CC4030
五、实验步骤
六、实验数据
K=0
K=1
CP
Q3
Q2
Q1
Q0
Q3
Q2
Q1
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- 设计 一个 可逆 二进制 计数器 实验 报告